logic gate level

　
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  • 邏輯門(mén)級

logic gate level的用法和樣例：

例句

  1. Constant components and output opened ports in the result of high level synthesis lead to explicit redundancy in gate level technology mapping.
    高級綜合結果中常量元件和輸出懸空端口導致門(mén)級工藝映射結果中存在顯式冗余。

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