high voltage interconnection
英
美
high voltage interconnection的用法和樣例:
例句
- Interconnection delay has become a dominant factor in IC design.
互連線(xiàn)時(shí)延是集成電路設計中非常重要的影響因素。
- A circuit analysis method for VHSIC system considering interconnection effects is presented in this paper.
摘要給出了高速集成電路系統在考慮互連線(xiàn)效應時(shí)的一種電路分析方法。
high voltage interconnection的相關(guān)資料:
臨近單詞
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