This thesis proposes a new digital controlled oscillator (DCO) and a new phase frequency detector (PFD) architecture for the all digital phase-locked loop (ADPLL) with low power design.

 
  • 本論文提出一個(gè)新的數位控制頻率振蕩器及一個(gè)新的相位頻率偵測器之架構以設計一個(gè)低功率的全數位式鎖相迴路。
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